解決ModelSim仿真中出現的vsim-3033錯誤

vsim-3033錯誤:Instantiation of 'XXXXX' failed. The design unit was not found.

XXXXX是你的工程名。字面含義為XXXXX這個模塊實例化失敗,因為設計單元沒有找到。筆者通過搜尋相關資料,找到一種解決辦法。筆者做的工程是通過原理圖的形式把各個模塊連接在一起,所以問題的關鍵筆者猜測是因為ModelSim不能正常識別原理圖形式。特來分享解決辦法,經過筆者驗證通過N次。

工具/原料

Altera Quartus 13.1
ModelSim 10.1d

方法/步驟

這是我的工程,此處省略一萬字。在做ModelSim仿真的時候出現vsim-3033錯誤。首先,經過Quartus編譯通過,在File菜單欄-Create/Update-Create HDL Design File From Current File。

筆者用的是Verilog,所以生成了Verilog文件。用VHDL的童鞋自己驗證……筆者沒有用過VHDL……

然後會在你當前的工程目錄下生成一個跟你頂層文件文件名一樣的V文件。例如筆者的頂層文件是BPSK.bdf,然後生成了BPSK.v。

然後把當前的原理圖bdf文件移除該工程,然後添加剛才生成的「工程名.v」文件到該工程,並設置成頂層模塊。並進行編譯。如圖。

如果出現錯誤,應該是你的工程中存在了兩個一模一樣的模塊名,編譯軟體無法識別。解決辦法就是按照剛才說的,要麼移除bdf文件,要麼更改bdf模塊名以避免重複。

這一步是整個解決方法的核心,其原理就是把bdf原理圖形式轉換成Verilog文件,有鑽研精神的童鞋可以打開V文件看一看,實際上就是實例化了原理圖中的所有的部件。

然後在進行ModelSim仿真,編寫TestBench文件,添加測試文件,此處省略一萬字,用過ModelSim的肯定都會。

最後,期待已久的波形,終於顯示啦!!

注意事項

步驟三是整個問題的核心部分,其原理就是原理圖文件轉換成普通的文本文件
這個方法也有一個缺點,就是每修改一次原理圖文件,就得按照這個步驟重新來一次,略顯繁瑣。
本文權當做拋磚引玉,如有更好的解決辦法,也請提出寶貴建議

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